???? 看完verilog那些事兒（以前看過部分），寫一個驅動7段數碼管的.v(以前寫過，并封裝成IP核，不過是參照別人的)，并用Modelsim仿真，驗證（以前沒有用過）。晚上寫今天完成的成果！

轉載于:https://www.cnblogs.com/Mrseven/archive/2011/10/16/2214006.html

《新程序員》：云原生和全面數字化實踐50位技術專家共同創作，文字、視頻、音頻交互閱讀

總結

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