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编程问答

Verilog MIPS32 CPU（一）-- PC寄存器

發(fā)布時(shí)間：2024/6/30 编程问答 30 豆豆

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Verilog MIPS32 CPU（一）-- PC寄存器
Verilog MIPS32 CPU（二）-- Regfiles
Verilog MIPS32 CPU（三）-- ALU
Verilog MIPS32 CPU（四）-- RAM
Verilog MIPS32 CPU（五）-- CP0
Verilog MIPS32 CPU（六）-- MDU
Verilog MIPS32 CPU（七）-- DIV、DIVU
Verilog MIPS32 CPU（八）-- 控制器

module pcreg(input clk,input rst,input ena,input [31:0] data_in,output [31:0] data_out);reg [31:0] data=32'b0;always @(posedge clk or posedge rst) beginif(rst) data<=32'h00400000; //reset keyelse beginif(ena) data<=data_in; //enable ,input endendassign data_out = data;endmodule

轉(zhuǎn)載于:https://www.cnblogs.com/liutianchen/p/7616749.html

總結(jié)

以上是生活随笔為你收集整理的Verilog MIPS32 CPU（一）-- PC寄存器的全部?jī)?nèi)容，希望文章能夠幫你解決所遇到的問(wèn)題。

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