內(nèi)容及要求： VHDL verilog都已設(shè)計(jì)驗(yàn)證！
設(shè)計(jì)乒乓球游戲電路，用按鍵與LED表示輸入與輸出。
（1）初始時(shí)，16個(gè)LED最邊上的點(diǎn)亮，按下鍵表示發(fā)球，亮的燈依次向?qū)Ψ揭苿?dòng)；當(dāng)?shù)竭_(dá)另一邊倒數(shù)第4個(gè)燈時(shí)表示乒乓球觸到桌面反彈；對(duì)方必須在反彈后且靠近己方的最后一個(gè)燈亮起來(lái)前按下按鍵表示接球，否則輸球；接球后燈亮的規(guī)則、對(duì)方接球的規(guī)則同發(fā)球；
（2）雙方靠近自己的4個(gè)燈亮鄧間隔0.4s，其余燈亮燈間隔0.8s；
（3）輸球或者犯規(guī)，本局游戲結(jié)束；
（4）乒乓球比賽規(guī)則計(jì)分，顯示于數(shù)碼管；
（5）工作時(shí)鐘100Hz即可；
（6）完成流程：設(shè)計(jì)規(guī)范文檔、底層模塊設(shè)計(jì)與代碼輸入及其功能仿真、約束與綜合、布局布線、下載驗(yàn)證等。

乒乓球游戲電路是一個(gè)對(duì)輸入信號(hào)、輸入時(shí)機(jī)正確與否的判斷，并用16個(gè)LED表示乒乓球球臺(tái)和乒乓球，用數(shù)碼管模擬顯示器，顯示比賽局?jǐn)?shù)比分和每局玩家得分的電路。電路并不復(fù)雜，整體分為兩個(gè)模塊：一，游戲主模塊；二，計(jì)分顯示模塊。主模塊完成用LED表示球和球臺(tái)并對(duì)玩家是否擊球、是否犯規(guī)做出判斷，并且將兩位玩家的游戲得分進(jìn)行輸出。計(jì)分顯示模塊完成對(duì)局?jǐn)?shù)比分的運(yùn)算，顯示局?jǐn)?shù)比分和每局游戲玩家的得分。實(shí)現(xiàn)中采用Verilog HDL描述、ModelSim進(jìn)行功能仿真、Quartus II 進(jìn)行邏輯綜合和適配下載，選用Cyclone系列EP1C6Q240C8型號(hào)的芯片上實(shí)現(xiàn)。在此過(guò)程中，完整地建立了測(cè)試平臺(tái)，完成了功能和時(shí)序仿真，從而保證了設(shè)

總結(jié)

以上是生活随笔為你收集整理的verilog or VHDL乒乓球游戏电路设计的全部?jī)?nèi)容，希望文章能夠幫你解決所遇到的問(wèn)題。

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