12 月 17 日消息，@結城安穗-YuuKi_AnS 放出了基于 Zen5 架構的 AMD EPYC 處理器 —— 都靈（Turin）的照片。

從圖來看，這一代處理器設計變化不大，相比 Genoa 幾乎沒有太大變化，只是支架的顏色發生了改變預計，將會與 SP5 平臺保持兼容性。

該系列處理器最多有 16 個 CCD，每個 CCD 帶有 8 個物理核心以及獨立的 32 MB L3 緩存，最多 128 個核心和 256 個線程以及 512 MB 的 L3 緩存。與基于 Zen 4 的 Genoa 系列 CPU 相比，該系列處理器增加了 33% 的核心數量以及 33% 的 L3 緩存。

此外，該系列處理器 IOD 將采用支持 6000 MT/s 速度的 DDR5 集成內存控制器，以及 PCIe Gen5 (CXL 2.0)、Gen3 Infinity Fabric 和安全處理器支持以及一系列其他控制器和加速器。

都靈屬于 AMD 第五代 EPYC 產品線，將用來取代當前第四代 EPYC 家族產品（Genoa、Genoa-X、Bergamo 和 Siena）。考慮到第四代 EPYC 處理器（9004/8004）使用了 Zen 4 + Zen 4C 混合架構，而第五代 EPYC 也將采用類似的 Zen 5（Nirvana） + Zen 5C（Prometheus）設計。

從 @結城安穗-YuuKi_AnS 給出的圖片來看，這顆都靈 ES2 芯片生產于 2023 年，看起來非常新。

實際上，@Ditto_55 上個月已經給出了該系列處理器（內部代號為 Breithorn）的 OPN 代碼，匯總如下：

• 100-000001245 -16 CCD + 1 IOD（128 個 Zen 5 核心 256 線程 512 MB 緩存）

• 100-000001341 -12 CCD + 1 IOD（96 個 Zen 5 核心 192 線程 384 MB 緩存）

• 100-000001247 -8 CCD + 1 IOD（64 個 Zen 5 核心 128 線程 256 MB 緩存）

• 100-000001342 -8 CCD + 1 IOD（64 個 Zen 5 核心 128 線程 256 MB 緩存）

• 100-000001249 - 2 CCD + 1 IOD（32 個 Zen 5C 核心 64 線程 64 MB 緩存）

相對于 Zen 5 CCD，每個 Zen 5C CCD 可提供最多 16 個核心和 32 MB 的 L3 緩存，再加上 6 個計算芯片，總共可實現 192 個物理核心和 256 個邏輯線程，但 L3 緩存僅為 384 MB，并將保留與其他芯片相同的 I / O 模塊。

與基于 Zen 4C 核心的 Bergamo 系列 CPU 相比，采用 Zen 5C 核心的 Turin 芯片核心和線程數將增加 50%（192/384 對 128/256），緩存數也將增加 50%（384 MB 對與 256 MB）。

AMD 已確認基于 Zen 5 架構的都靈 CPU 將于 2024 年推出，并將帶來更強的單位功耗性能，從而對抗英特爾新一代的 Granite Rapids Xeon 芯片。

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總結

以上是生活随笔為你收集整理的AMD EPYC“都灵”CPU 曝光：采用 Zen 5 + Zen 5C 混合设计，128 核心 256 线程的全部內容，希望文章能夠幫你解決所遇到的問題。

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