不重疊序列檢測

題目描述
請編寫一個序列檢測模塊，檢測輸入信號（a）是否滿足011100序列， 要求以每六個輸入為一組，不檢測重復序列，例如第一位數(shù)據(jù)不符合，則不考慮后五位。一直到第七位數(shù)據(jù)即下一組信號的第一位開始檢測。當信號滿足該序列，給出指示信號match。當不滿足時給出指示信號not_match。

模塊的接口信號圖如下：

模塊的時序圖如下：

`timescale 1ns/1ns module sequence_detect(input clk,input rst_n,input data,output reg match,output reg not_match);reg [0:2] cnt;//六個時鐘的計數(shù)always@(posedge clk or negedge rst_n)beginif(!rst_n)cnt <= 3'b0;else if ( cnt == 3'd5)cnt <= 3'b0;elsecnt <= cnt + 1'b1;endreg [5:0] data_reg;always@(*)begincase(cnt)3'd0:data_reg[5] = data;3'd1:data_reg[4] = data;3'd2:data_reg[3] = data;3'd3:data_reg[2] = data;3'd4:data_reg[1] = data;3'd5:data_reg[0] = data;default:data_reg = 6'b0;endcaseendalways@(posedge clk or negedge rst_n)beginif(!rst_n)match = 1'b0;else if(data_reg == 6'b011100 && cnt == 3'd5)match = 1'b1;elsematch = 1'b0;endalways@(posedge clk or negedge rst_n)beginif(!rst_n)not_match = 1'b0;else if(data_reg != 6'b011100 && cnt == 3'd5)not_match = 1'b1;elsenot_match = 1'b0;end endmodule

知識點
移位寄存器不僅能寄存數(shù)據(jù)，而且能在時鐘信號的作用下使其中的數(shù)據(jù)依次左移或右移。

總結(jié)

以上是生活随笔為你收集整理的不重叠序列检测的全部內(nèi)容，希望文章能夠幫你解決所遇到的問題。

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