1．當HSI被用于作為PLL時鐘的輸入時，系統時鐘能得到的最大頻率是64MHz。
2．對于內部和外部時鐘源的特性，請參考相應產品數據手冊中“電氣特性”章節。
用戶可通過多個預分頻器配置AHB、高速APB(APB2)和低速APB(APB1)域的頻率。AHB和APB2域的最大頻率是72MHz。APB1域的最大允許頻率是36MHz。SDIO接口的時鐘頻率固定為HCLK/2。
RCC通過AHB時鐘(HCLK)8分頻后作為Cortex系統定時器(SysTick)的外部時鐘。通過對SysTick控制與狀態寄存器的設置，可選擇上述時鐘或Cortex(HCLK)時鐘作為SysTick時鐘。ADC時鐘由高速APB2時鐘經2、4、6或8分頻后獲得。
定時器時鐘頻率分配由硬件按以下2種情況自動設置：
1. 如果相應的APB預分頻系數是1，定時器的時鐘頻率與所在APB總線頻率一致。
2. 否則，定時器的時鐘頻率被設為與其相連的APB總線頻率的2倍。
FCLK是Cortex?-M3的自由運行時鐘。詳情見ARM的Cortex?-M3技術參考手冊。?

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總結

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